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game_of_life_v2.xpr

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  • game_of_life_v2.xpr 6.71 KiB
    <?xml version="1.0" encoding="UTF-8"?>
    <!-- Product Version: Vivado v2017.4 (64-bit)              -->
    <!--                                                         -->
    <!-- Copyright 1986-2017 Xilinx, Inc. All Rights Reserved.   -->
    
    <Project Version="7" Minor="35" Path="/home/mlipe/dev/fpga_project/game_of_life_v2/game_of_life_v2.xpr">
      <DefaultLaunch Dir="$PRUNDIR"/>
      <Configuration>
        <Option Name="Id" Val="3e265ee7ec4345a3a8b6f0b7f2e11715"/>
        <Option Name="Part" Val="xc7z020clg484-1"/>
        <Option Name="CompiledLibDir" Val="$PCACHEDIR/compile_simlib"/>
        <Option Name="CompiledLibDirXSim" Val=""/>
        <Option Name="CompiledLibDirModelSim" Val="$PCACHEDIR/compile_simlib/modelsim"/>
        <Option Name="CompiledLibDirQuesta" Val="$PCACHEDIR/compile_simlib/questa"/>
        <Option Name="CompiledLibDirIES" Val="$PCACHEDIR/compile_simlib/ies"/>
        <Option Name="CompiledLibDirXcelium" Val="$PCACHEDIR/compile_simlib/xcelium"/>
        <Option Name="CompiledLibDirVCS" Val="$PCACHEDIR/compile_simlib/vcs"/>
        <Option Name="CompiledLibDirRiviera" Val="$PCACHEDIR/compile_simlib/riviera"/>
        <Option Name="CompiledLibDirActivehdl" Val="$PCACHEDIR/compile_simlib/activehdl"/>
        <Option Name="TargetLanguage" Val="VHDL"/>
        <Option Name="BoardPart" Val="em.avnet.com:zed:part0:1.3"/>
        <Option Name="ActiveSimSet" Val="sim_1"/>
        <Option Name="DefaultLib" Val="xil_defaultlib"/>
        <Option Name="ProjectType" Val="Default"/>
        <Option Name="IPOutputRepo" Val="$PCACHEDIR/ip"/>
        <Option Name="IPCachePermission" Val="read"/>
        <Option Name="IPCachePermission" Val="write"/>
        <Option Name="EnableCoreContainer" Val="FALSE"/>
        <Option Name="CreateRefXciForCoreContainers" Val="FALSE"/>
        <Option Name="IPUserFilesDir" Val="$PIPUSERFILESDIR"/>
        <Option Name="IPStaticSourceDir" Val="$PIPUSERFILESDIR/ipstatic"/>
        <Option Name="EnableBDX" Val="FALSE"/>
        <Option Name="DSAVendor" Val="xilinx"/>
        <Option Name="DSABoardId" Val="zed"/>
        <Option Name="DSANumComputeUnits" Val="60"/>
        <Option Name="WTXSimLaunchSim" Val="0"/>
        <Option Name="WTModelSimLaunchSim" Val="0"/>
        <Option Name="WTQuestaLaunchSim" Val="0"/>
        <Option Name="WTIesLaunchSim" Val="0"/>
        <Option Name="WTVcsLaunchSim" Val="0"/>
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        <Option Name="WTActivehdlLaunchSim" Val="0"/>
        <Option Name="WTXSimExportSim" Val="0"/>
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        <Option Name="WTQuestaExportSim" Val="0"/>
        <Option Name="WTIesExportSim" Val="0"/>
        <Option Name="WTVcsExportSim" Val="0"/>
        <Option Name="WTRivieraExportSim" Val="0"/>
        <Option Name="WTActivehdlExportSim" Val="0"/>
        <Option Name="GenerateIPUpgradeLog" Val="TRUE"/>
        <Option Name="XSimRadix" Val="hex"/>
        <Option Name="XSimTimeUnit" Val="ns"/>
        <Option Name="XSimArrayDisplayLimit" Val="1024"/>
        <Option Name="XSimTraceLimit" Val="65536"/>
        <Option Name="SimTypes" Val="rtl"/>
      </Configuration>
      <FileSets Version="1" Minor="31">
        <FileSet Name="sources_1" Type="DesignSrcs" RelSrcDir="$PSRCDIR/sources_1">
          <Filter Type="Srcs"/>
          <File Path="$PSRCDIR/sources_1/new/game_of_life.vhd">
            <FileInfo>
              <Attr Name="UsedIn" Val="synthesis"/>
              <Attr Name="UsedIn" Val="simulation"/>
            </FileInfo>
          </File>
          <Config>
            <Option Name="DesignMode" Val="RTL"/>
            <Option Name="TopModule" Val="game_of_life"/>
            <Option Name="TopAutoSet" Val="TRUE"/>
          </Config>
        </FileSet>
        <FileSet Name="constrs_1" Type="Constrs" RelSrcDir="$PSRCDIR/constrs_1">
          <Filter Type="Constrs"/>
          <File Path="$PSRCDIR/constrs_1/new/constraints.xdc">
            <FileInfo>
              <Attr Name="UsedIn" Val="synthesis"/>
              <Attr Name="UsedIn" Val="implementation"/>
            </FileInfo>
          </File>
          <Config>
            <Option Name="ConstrsType" Val="XDC"/>
          </Config>
        </FileSet>
        <FileSet Name="sim_1" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/sim_1">
          <Config>
            <Option Name="DesignMode" Val="RTL"/>
            <Option Name="TopModule" Val="game_of_life"/>
            <Option Name="TopLib" Val="xil_defaultlib"/>
            <Option Name="TopAutoSet" Val="TRUE"/>
            <Option Name="TransportPathDelay" Val="0"/>
            <Option Name="TransportIntDelay" Val="0"/>
            <Option Name="SrcSet" Val="sources_1"/>
          </Config>
        </FileSet>
      </FileSets>
      <Simulators>
        <Simulator Name="XSim">
          <Option Name="Description" Val="Vivado Simulator"/>
          <Option Name="CompiledLib" Val="0"/>
        </Simulator>
        <Simulator Name="ModelSim">
          <Option Name="Description" Val="ModelSim Simulator"/>
        </Simulator>
        <Simulator Name="Questa">
          <Option Name="Description" Val="Questa Advanced Simulator"/>
        </Simulator>
        <Simulator Name="IES">
          <Option Name="Description" Val="Incisive Enterprise Simulator (IES)"/>
        </Simulator>
        <Simulator Name="VCS">
          <Option Name="Description" Val="Verilog Compiler Simulator (VCS)"/>
        </Simulator>
        <Simulator Name="Riviera">
          <Option Name="Description" Val="Riviera-PRO Simulator"/>
        </Simulator>
      </Simulators>
      <Runs Version="1" Minor="10">
        <Run Id="synth_1" Type="Ft3:Synth" SrcSet="sources_1" Part="xc7z020clg484-1" ConstrsSet="constrs_1" Description="Vivado Synthesis Defaults" WriteIncrSynthDcp="false" State="current" IncludeInArchive="true">
          <Strategy Version="1" Minor="2">
            <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2017">
              <Desc>Vivado Synthesis Defaults</Desc>
            </StratHandle>
            <Step Id="synth_design"/>
          </Strategy>
          <ReportStrategy Name="Vivado Synthesis Default Reports" Flow="Vivado Synthesis 2017"/>
          <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
        </Run>
        <Run Id="impl_1" Type="Ft2:EntireDesign" Part="xc7z020clg484-1" ConstrsSet="constrs_1" Description="Default settings for Implementation." WriteIncrSynthDcp="false" State="current" SynthRun="synth_1" IncludeInArchive="true">
          <Strategy Version="1" Minor="2">
            <StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2017">
              <Desc>Default settings for Implementation.</Desc>
            </StratHandle>
            <Step Id="init_design"/>
            <Step Id="opt_design"/>
            <Step Id="power_opt_design"/>
            <Step Id="place_design"/>
            <Step Id="post_place_power_opt_design"/>
            <Step Id="phys_opt_design"/>
            <Step Id="route_design"/>
            <Step Id="post_route_phys_opt_design"/>
            <Step Id="write_bitstream"/>
          </Strategy>
          <ReportStrategy Name="Vivado Implementation Default Reports" Flow="Vivado Implementation 2017"/>
          <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
        </Run>
      </Runs>
      <Board>
        <Jumpers/>
      </Board>
    </Project>